Strombelastbarkeit Via?

Hallo,

vielleicht waren meine Suchbegriffe falsch, aber ich habe im Netz nichts zur Strombelastbarkeit bzw. Widerstand von Vias auf Leiterplatten gefunden. Hat jemand einen Link zu einer Tabelle o.ä.?

TIA, Michael

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Michael Hofmann
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Michael Hofmann schrieb:

s=20

Hallo,

naja, der Widerstand l=E4sst sich aus der Plattendicke, dem=20 Viabohrlochdurchmesser, der Kupferschichtdicke in der Bohrung und der=20 Leitf=E4higkeit von Kupfer ausrechnen. Zu beachten w=E4re das bei einem=20 Kupferaufbau aus 18 =B5m Basiskupfer und 18=B5m galvanischem Kupfer,=20 insgesamt also 35 =B5m, die Schichtdicke im Bohrloch nur 18 =B5m und weni= ger=20 betr=E4gt.

Tabellen und Kurven zur Strombelastbarkeit von Leiterbahnen gibts, wenn=20 der Widerstand der Vias gegen=FCber dem gesamten Widerstand des ganzen=20 Leiterbahnzuges auf beiden Seiten vernachl=E4ssigbar klein ist sollte die= =20 Belastbarkeit nur von den Leiterbahnen selbst abh=E4ngen. Nat=FCrlich sollte man f=FCr st=E4rker belastete Leiterbahnen den=20 Kupferquerschnit im Via nicht wesentlich kleiner als den Querschnitt der =

zugeh=F6rigen Leiterbahnen machen.

Die zul=E4ssigen Toleranzen von Leiterbreite und Schichtdicken bei=20 Leiterplatten sollte man sich dazu allerdings auch mal genau anschauen.

Einige Infos dazu gibts hier:

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Bye

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Uwe Hercksen

Vielen Dank. Etwas mehr Praxisbezug zu Vias gibt's hier:

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- Tips für Entwickler - Layout Tips - elektrische Bemessungsrichtlinien

Gruß, Michael

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Michael Hofmann

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