ich habe nicht so wahnsinnig viel Erfahrung darin Augendiagramme zu interpretieren, daher bin ich
Ich habe einen FPGA, der eine 250 MHz (gated)-clock an einen IC sendet, der IC wiederum schickt dann
FPGA. Daten und Clock sind LVDS-Signale.
Unter
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ist das Augendiagramm der Clock zu sehen, sieht erstmal gut aus.
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Ansich auch nicht ganz verkehrt nur diese "Einbuchtungen" im Auge (im Bild mit Pfeilen markiert) irritieren micht etwas. Wenn das eine Reflektion
1.3nsec. Bei einer Ausbreitungsgeschwindigkeit von ca. 0.5*c (macht:
Datenleitung geschickt, sieht so aus:
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IMHO auch sehr ordentlich. Wo kommt also diese Einbuchtung her? Ideen? Schlechter Transmitter im IC? Power am IC sieht auch gut aus, hm.
gw
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Ausser Johnson, Graham "High Speed Digital Design: A Handbook of Black Magic"
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Simplified"
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vielen Wegen einfangen. Etwas schmal Thierauf "High-Speed Circuit Board Signal Integrity" ( Ex DEC Alpha Entwicklungsgruppe )
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Sowie das klassische Handbuch von Motorola vorzugsweise in der 4. Auflage: Blood "MECL system design handbook"
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Wo man sieht wie auf 2lagigen Boards in DIL gewerkelt wird. ECL selbst ist allerdings kaum noch relevant.
Der Autor von diesem Buch ( AT&T/Bell Labs ):
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empfiehlt selbstgebaute Probes mit 50 Ohm Koax-Kabel
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die auf Seite Oszilloskop mit 50 Ohm terminiert werden
50 Ohm weniger gut sind als wenn das Oszilloskop selbst
50Ohm//wenige-pF kann. Datenblatt ist zwar ziemlich diffus wieviel pF die 50 Ohm haben, aber das HP/Agilent/Keysight das mir die Firma auf den Tisch gestellt hat kann man auf 50 Ohm umschalten.
Ne, leider garnix. Die P1V8 sehen sauber aus. Kein "Digital"-Noise und vielleicht 40mVpp Rippel (ca. 2%, nicht perfekt aber ordentlich). Ich tippe aber auch auf den Transmitter. Es handelt sich bei dem IC nicht um ein Massenprodukt, daher ist u.U. fraglich wie gut
Ich werde mal statt dem 100 Ohm Widerstand einen mit ~80 Ohm
Wir werden sehen.
/grw
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