ABEL-HDL Reset .ar

hallo , ich habe folgendes Problem bei der Realisierung einer ispGAL Schaltung. Programmierung in Abel-HDL.

Ich m=F6chte 3 FlipFLops gleichzeitig l=F6schen, und zwar asynchron! Das Signal, was am .ar Eingang anliegt ist aber zeitlich l=E4nger als ein clocksignal! Daher bleiben die Register zu lange auf 0, obwohl ich sie schon im n=E4chsten Takt wieder ben=F6tige! Hat jemand ne L=F6sung?!

Danke !

Flo

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Florian Toulouse
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hallo , ich habe folgendes Problem bei der Realisierung einer ispGAL Schaltung. Programmierung in Abel-HDL.

Ich m=F6chte 3 FlipFLops gleichzeitig l=F6schen, und zwar asynchron! Das Signal, was am .ar Eingang anliegt ist aber zeitlich l=E4nger als ein clocksignal! Daher bleiben die Register zu lange auf 0, obwohl ich sie schon im n=E4chsten Takt wieder ben=F6tige! Hat jemand ne L=F6sung?!

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Flo

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Florian Toulouse

hallo , ich habe folgendes Problem bei der Realisierung einer ispGAL Schaltung. Programmierung in Abel-HDL.

Ich m=F6chte 3 FlipFLops gleichzeitig l=F6schen, und zwar asynchron! Das Signal, was am .ar Eingang anliegt ist aber zeitlich l=E4nger als ein clocksignal! Daher bleiben die Register zu lange auf 0, obwohl ich sie schon im n=E4chsten Takt wieder ben=F6tige! Hat jemand ne L=F6sung?!

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Flo

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Florian Toulouse

hallo , ich habe folgendes Problem bei der Realisierung einer ispGAL Schaltung. Programmierung in Abel-HDL.

Ich m=F6chte 3 FlipFLops gleichzeitig l=F6schen, und zwar asynchron! Das Signal, was am .ar Eingang anliegt ist aber zeitlich l=E4nger als ein clocksignal! Daher bleiben die Register zu lange auf 0, obwohl ich sie schon im n=E4chsten Takt wieder ben=F6tige! Hat jemand ne L=F6sung?!

Danke !

Flo

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Florian Toulouse

Du hast noch mehr Probleme, einmal senden hätte gereicht.

Lutz

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E-Mail an Adresse im FROM wird ungelesen gelöscht
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Lutz Illigen

Gleichzeitig und asynchron ist schon ein Widerspruch in sich. Selbst wenn du das reset kürzer als die Taktperiode hinbekommst, aber asynchron zum Takt lässt, werden gelegentlich nur einige der FFs im gleichen Takt reagieren.

Zu beherrschen sind Schaltwerke mit mehreren FlipFlops eigentlich nur, wenn man sämtliche Eingangssignale mit dem Takt synchronisiert. Evtl. hilft es, den Takt schneller zu machen damit die Synchronisierzeit nicht so Weh tut.

Wenn es partout asynchron sein soll, kann man das schon hinkriegen. Vom Anspruch her spielt das aber in einer anderen Liga. Versuche es nicht ohne lokalen Guru. Google z.B. nach Muller-c-element. (ohne Umlaut).

Gruß, Gerhard

ps bitte nicht hauen, wenn meine Umlaute etc falsch sind. Neuer Rechner, System, newsreader und Provider...

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Gerhard Hoffmann

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